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基于控閾技術(shù)的并行式A/D轉(zhuǎn)換器設(shè)計

吳訓(xùn)威,  杭國強(qiáng)

吳訓(xùn)威, 杭國強(qiáng). 基于控閾技術(shù)的并行式A/D轉(zhuǎn)換器設(shè)計[J]. 電子與信息學(xué)報, 2002, 24(2): 250-256.
引用本文: 吳訓(xùn)威, 杭國強(qiáng). 基于控閾技術(shù)的并行式A/D轉(zhuǎn)換器設(shè)計[J]. 電子與信息學(xué)報, 2002, 24(2): 250-256.
Wu Xunwei, Hang Guojiang. Design of parallel A/D converter based on threshold-controllable technique[J]. Journal of Electronics & Information Technology, 2002, 24(2): 250-256.
Citation: Wu Xunwei, Hang Guojiang. Design of parallel A/D converter based on threshold-controllable technique[J]. Journal of Electronics & Information Technology, 2002, 24(2): 250-256.

基于控閾技術(shù)的并行式A/D轉(zhuǎn)換器設(shè)計

Design of parallel A/D converter based on threshold-controllable technique

  • 摘要: 該文將數(shù)字電路設(shè)計中空間-時間等效思想及閾值控制技術(shù)兩者引入A/D轉(zhuǎn)換器的設(shè)計,所設(shè)計出的A/D轉(zhuǎn)換器在保證較高速度的同時具有相對簡單的電路結(jié)構(gòu)。
    Abstract: Space-time equivalence in digital design and the threshold-controllable technique arc introduced to the design of A/D converter in this paper. The proposed A/D converter has simpler structure while keeping higher speed.
    • HTML全文
  • 趙保經(jīng)等編著,A/D和D/A轉(zhuǎn)換器應(yīng)用手冊,上海,上?？茖W(xué)普及出版社,1995,第二章.[2]P.E. Allen, D. R. Holberg. CMOS Analog Circuit Design, New York, Holt, Rinehart and winston,1987, Chap. 10. ［3］Y.T. Wang, B. Razavi. An 8-bit 150-MHz CMOS A/D converter, IEEE J. of Solid-State Circuits,2000, 35(3), 308-317.[3]Y. Geerts, A. M. Marques, M. S. J. Steyaert, et al., A 3.3-V, 15-bit, delta-sigma ADC with a signal bandwidth of 1.1 MHz for ADSL applications, IEEE J. of Solid-State Circuits, 1999, 34(7).927-936.[4]吳訓(xùn)戚,章專,ECL集成電路的四值接口技術(shù),電子科學(xué)學(xué)刊,1991,13(5),456-460[5]杭國強(qiáng),吳訓(xùn)威,采用變閾技術(shù)的ECL4-2譯碼器改進(jìn)設(shè)計,杭州大學(xué)學(xué)報(自然科學(xué)版),1996 23(4),388-389[6]吳訓(xùn)威,F Prosser,數(shù)字電路的開關(guān)級設(shè)計理論,中國科學(xué)(E輯),1996,26(3),257-265[7]吳訓(xùn)威著,多值邏輯電路設(shè)計原理,杭州,杭州大學(xué)出版社,1994,第十章.
  • 加載中
計量
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  • 被引次數(shù): 0
出版歷程
  • 收稿日期:  2000-05-10
  • 修回日期:  2000-12-29
  • 刊出日期:  2002-02-19

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